面向栈式浮点架构使用规则翻译的动态二进制翻译方法
实质审查的生效
摘要

本发明提供一种面向栈式浮点架构使用规则翻译的动态二进制翻译方法,扩展了翻译规则的适用范围,提高了现有动态二进制翻译系统对于栈式浮点指令集的支持。本发明具体操作如下,在翻译规则匹配过程中,通过虚拟化栈寄存器保证翻译规则的正确性,进而在实例化翻译规则中产生正确的目标架构指令序列;在生成目标代码时,结合浮点寄存器栈的特点,利用寄存器分配约束对浮点栈的寄存器进行分配,通过标识目标寄存器和出栈操作,实现源架构寄存器与目标架构寄存器同步,最终生成高效的目标架构浮点指令序列。相较于软件模拟的浮点指令翻译方法,本发明的方法在保证正确翻译的情况下,实现了高效的动态二进制翻译。

基本信息
专利标题 :
面向栈式浮点架构使用规则翻译的动态二进制翻译方法
专利标题(英):
暂无
公开(公告)号 :
CN114546411A
申请号 :
CN202210176244.X
公开(公告)日 :
2022-05-27
申请日 :
2022-02-24
授权号 :
暂无
授权日 :
暂无
发明人 :
张为华鲁云萍蒋金虎
申请人 :
复旦大学
申请人地址 :
上海市杨浦区邯郸路220号
代理机构 :
上海德昭知识产权代理有限公司
代理人 :
程宗德
优先权 :
CN202210176244.X
主分类号 :
G06F8/52
IPC分类号 :
G06F8/52  G06F8/41  G06F40/16  
IPC结构图谱
G
G部——物理
G06
计算;推算或计数
G06F
电数字数据处理
G06F8/00
软件工程设计
G06F8/40
程序代码转换
G06F8/52
二进制到二进制
法律状态
2022-06-14 :
实质审查的生效
IPC(主分类) : G06F 8/52
申请日 : 20220224
2022-05-27 :
公开
注:本法律状态信息仅供参考,即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
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