窄通道布局下宏单元的逻辑输出预导引结构

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摘要

本实用新型实施例涉及一种窄通道布局下宏单元的逻辑输出预导引结构。第一宏单元与第二宏单元为相邻的两个宏单元，它们之间为第一通道；第一通道内具有走线轨道资源，包括多个平行第一通道方向的第一走线轨道和多个垂直第一通道方向的第二走线轨道；第一/第二缓冲器阵列均设置在第一通道内，且分别呈折线形状排列；其中，第一/第二缓冲器阵列中的每一个缓冲器依次设置在第一数量/第二数量的第一走线轨道中的一个第一走线轨道上，并沿第一走线轨道与第一/第二宏单元的一个对应引脚通过布线连接；第一数量与第二数量之和小于等于总数量；每个缓冲器阵列中，相邻的缓冲器之间在沿第一走线轨道方向和第二走线轨道方向上均具有至少一个走线轨道的位移。

基本信息

专利标题：

窄通道布局下宏单元的逻辑输出预导引结构

专利标题（英）：

暂无

公开（公告）号：

暂无

申请号：

CN202021868384.6

公开（公告）日：

暂无

申请日：

2020-08-28

授权号：

CN212484368U

授权日：

2021-02-05

发明人：

赵少峰

申请人：

安徽省东科半导体有限公司

申请人地址：

安徽省马鞍山市当涂县银黄东路999号数字硅谷国际产业园第38栋

代理机构：

北京慧诚智道知识产权代理事务所(特殊普通合伙)

代理人：

李楠

优先权：

CN202021868384.6

主分类号：

G06F30/3947

IPC分类号：

G06F30/3947