用于可重配置架构的编译器流程逻辑
公开
摘要

所公开的技术将高级程序的数据流图分割成存储器分配和执行片段。存储器分配表示在处理器上的和/或处理器外的存储器中为实现数据流图所需的数据创建逻辑存储器空间。执行片段表示对数据的操作。所公开的技术将存储器分配指定给虚拟存储器单元,并且将执行片段指定给虚拟计算单元。所公开的技术将执行片段分割成存储器片段和计算片段,并且将存储器片段指派给虚拟存储器单元,将计算片段指派给虚拟计算单元。所公开的技术然后将虚拟存储器单元分配给物理存储器单元,并且将虚拟计算单元分配给物理计算单元。然后,其将物理存储器单元和物理计算单元放置在可配置单元阵列中的位置上,并且在放置的位置之间路由数据和控制网络。

基本信息
专利标题 :
用于可重配置架构的编译器流程逻辑
专利标题(英):
暂无
公开(公告)号 :
CN114450661A
申请号 :
CN202080067026.1
公开(公告)日 :
2022-05-06
申请日 :
2020-08-07
授权号 :
暂无
授权日 :
暂无
发明人 :
D·A·凯普林格R·普拉巴卡尔S·贾拉特
申请人 :
圣巴诺瓦系统公司
申请人地址 :
美国加利福尼亚州
代理机构 :
北京市金杜律师事务所
代理人 :
董莘
优先权 :
CN202080067026.1
主分类号 :
G06F8/41
IPC分类号 :
G06F8/41  G06F15/78  G06F16/901  G06F12/02  
IPC结构图谱
G
G部——物理
G06
计算;推算或计数
G06F
电数字数据处理
G06F8/00
软件工程设计
G06F8/40
程序代码转换
G06F8/41
编译
法律状态
2022-05-06 :
公开
注:本法律状态信息仅供参考,即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
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