奇偶校验位生成电路、计数电路以及计数方法
专利权的终止
摘要

本发明提供一种奇偶校验位生成电路、计数电路以及计数方法。当针对8位输入数据(X<7:0>)可取的从0至255的256组值,判断输入数据的奇偶校验(X

)、POP(Z<3:0>)和POP的奇偶校验(Z

)取哪组的值时,可知在POP为“0”、“1”、“6”、“7”之中的任意一个的情况下,X

与Z

一致,在POP为“2”、“3”、“4”、“5”、“8”之中的任意一个的情况下,X

与Z

反转。利用这种规律性来实现奇偶校验的预测。

基本信息
专利标题 :
奇偶校验位生成电路、计数电路以及计数方法
专利标题(英):
暂无
公开(公告)号 :
CN101361278A
申请号 :
CN200680051417.4
公开(公告)日 :
2009-02-04
申请日 :
2006-01-19
授权号 :
暂无
授权日 :
暂无
发明人 :
山下英男
申请人 :
富士通株式会社
申请人地址 :
日本神奈川县
代理机构 :
北京三友知识产权代理有限公司
代理人 :
黄纶伟
优先权 :
CN200680051417.4
主分类号 :
H03M13/09
IPC分类号 :
H03M13/09  G06F11/10  
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法律状态
2017-03-08 :
专利权的终止
未缴年费专利权终止号牌文件类型代码 : 1605
号牌文件序号 : 101707181072
IPC(主分类) : H03M 13/09
专利号 : ZL2006800514174
申请日 : 20060119
授权公告日 : 20120201
终止日期 : 20160119
2012-02-01 :
授权
2009-04-01 :
实质审查的生效
2009-02-04 :
公开
注:本法律状态信息仅供参考,即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
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