面向多核处理器的自适应容错数据并行计算实现方法

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摘要

本发明公开一种面向多核处理器的自适应容错数据并行计算实现方法，该方法步骤包括：步骤1：设置一个全局寄存器R；步骤2：当需目标多核处理器执行数据并行计算时，目标多核处理器的每个核启动后分别读取全局寄存器R；步骤3：目标多核处理器的每个核每次计算时，分别计算各核所需负责计算的数据块地址以及当前计算任务的剩余计算数据量，并计算各核每次计算时的实际负载；步骤4：目标多核处理器的每个核分别根据每次计算时的数据块地址以及实际负载执行计算；步骤5：完成所有计算数据量的计算后退出。本发明能够在部分核失效时仍自适应正确执行数据并行计算，具有实现方法简单、自适应容错性能好且应用灵活等优点。

基本信息

专利标题：

面向多核处理器的自适应容错数据并行计算实现方法

专利标题（英）：

暂无

公开（公告）号：

CN110806938A

申请号：

CN201911000659.6

公开（公告）日：

2020-02-18

申请日：

2019-10-21

授权号：

CN110806938B

授权日：

2022-06-07

发明人：

刘仲郭阳扈啸田希邓林陈海燕李勇吴虎成孙书为李程

申请人：

中国人民解放军国防科技大学

申请人地址：

湖南省长沙市开福区砚瓦池正街47号

代理机构：

湖南兆弘专利事务所(普通合伙)

代理人：

周长清

优先权：

CN201911000659.6

主分类号：

G06F9/50

IPC分类号：

G06F9/50