一种验证SPI总线时序容限的夹具
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摘要

本实用新型公开了一种验证SPI总线时序容限的夹具,包括CLK信号输入端、CLK信号输出端、MOSI信号输入端和MOSI信号输出端,CLK信号输入端和CLK信号输出端通过三种不同长度的CLK连接线连接,MOSI信号输入端和MOSI信号输出端之间通过三种不同长度的MOSI连接线连接。实现起来容易,能够验证SPI总线时序的容限,并验证SPI总线时序在不同的容限下能否正常工作,此方案成本低廉,极具性价比。

基本信息
专利标题 :
一种验证SPI总线时序容限的夹具
专利标题(英):
暂无
公开(公告)号 :
暂无
申请号 :
CN202022191641.3
公开(公告)日 :
暂无
申请日 :
2020-09-29
授权号 :
CN212846775U
授权日 :
2021-03-30
发明人 :
陈晨杨成
申请人 :
太仓市同维电子有限公司
申请人地址 :
江苏省苏州市太仓市娄东街道江南路89号
代理机构 :
北京天奇智新知识产权代理有限公司
代理人 :
刘黎明
优先权 :
CN202022191641.3
主分类号 :
G06F11/273
IPC分类号 :
G06F11/273  
相关图片
IPC结构图谱
G
G部——物理
G06
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G06F
电数字数据处理
G06F11/00
错误检测;错误校正;监控
G06F11/22
在准备运算或者在空闲时间期间内,通过测试作故障硬件的检测或定位
G06F11/26
功能检验
G06F11/273
检验器硬件,即输出处理电路
法律状态
2021-03-30 :
授权
注:本法律状态信息仅供参考,即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
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