半导体结构及其制备方法
授权
摘要
本发明涉及一种半导体结构及其制备方法，包括：衬底；沟槽，位于衬底内；位线接触结构，位于沟槽内，且位线接触结构的上表面低于衬底的上表面，位线接触结构沿第一方向延伸；位线结构，位于位线接触结构上，且至少部分位于沟槽内；位线保护结构，包括顶层介质层及侧墙结构，顶层介质层位于位线结构上，与位线结构共同构成叠层结构；侧墙结构覆盖叠层结构位于衬底上的部分的侧壁，侧墙结构内具有第一空气间隙；隔离图形结构，隔离图形结构内具有第二空气间隙，所述隔离图形结构沿第二方向延伸，所述第二方向与所述第一方向相交，以于相邻位线保护结构之间及相邻隔离图形结构之间形成电容接触孔。可以减小电容接触孔的尺寸。
基本信息
专利标题 ：
半导体结构及其制备方法
专利标题（英）：
暂无
公开（公告）号 ：
CN113097210A
申请号 ：
CN202110350204.8
公开（公告）日 ：
2021-07-09
申请日 ：
2021-03-31
授权号 ：
CN113097210B
授权日 ：
2022-05-03
发明人 ：
于业笑张俊逸
申请人 ：
长鑫存储技术有限公司
申请人地址 ：
安徽省合肥市经济技术开发区空港工业园兴业大道388号
代理机构 ：
广州华进联合专利商标代理有限公司
代理人 ：
姚姝娅
优先权 ：
CN202110350204.8
主分类号 ：
H01L27/108
IPC分类号 ：
H01L27/108 H01L21/8242
IPC结构图谱
H
H部——电学
H01
基本电气元件
H01L
半导体器件；其他类目中不包括的电固体器件
H01L27/00
由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27/02
包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的；包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27/04
其衬底为半导体的
H01L27/10
在重复结构中包括有多个独立组件的
H01L27/105
包含场效应组件的
H01L27/108
动态随机存取存储结构的
法律状态
2022-05-03 ：
授权
2021-07-27 ：
实质审查的生效
IPC(主分类) : H01L 27/108
申请日 : 20210331
申请日 : 20210331
2021-07-09 ：
公开
注：本法律状态信息仅供参考，即时准确的法律状态信息须到国家知识产权局办理专利登记簿副本。
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